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采用創(chuàng)新的FPGA 器件來實(shí)現(xiàn)更經(jīng)濟(jì)且更高能效的大模型推理解決方案
采用 FPGA 器件來加速LLM 性能，在運(yùn)行 Llama2 70B 參數(shù)模型時，Speedster7t FPGA 如何與 GPU 解決方案相媲美？證據(jù)是令人信服的——Achronix Speedster7t FPGA通過提供計(jì)算能力、內(nèi)存帶寬和卓越能效的最佳組合，在處理大型語言模型（LLM）方面表現(xiàn)出色，這是當(dāng)今LLM復(fù)雜需求的基本要求。
2024-06-14
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面向現(xiàn)代視覺系統(tǒng)的低功耗圖像傳感器
在更快的連接速度、更高的自動化程度和更智能系統(tǒng)的推動下，工業(yè)4.0加快了視覺技術(shù)在制造業(yè)中的應(yīng)用，并將智能化引入到以往簡單的數(shù)據(jù)采集系統(tǒng)中。上一代視覺系統(tǒng)負(fù)責(zé)捕捉圖像，對其進(jìn)行封裝以供傳輸，并為后續(xù)的FPGA、ASIC或昂貴的SoC等器件提供圖像數(shù)據(jù)進(jìn)行處理。如今，工業(yè)5.0更進(jìn)一步，通過在整個數(shù)據(jù)通路中融入人工智能（AI）與機(jī)器學(xué)習(xí)（ML），實(shí)現(xiàn)大規(guī)模定制化。攝像頭變得智能化，具備在應(yīng)用層面處理的圖像數(shù)據(jù)，僅輸出用于決策的元數(shù)據(jù)。
2024-05-28
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嵌入式系統(tǒng)的微處理器選擇
任何一個電子系統(tǒng)都需要一個微處理器（MPU）內(nèi)核，當(dāng)然也有些系統(tǒng)會選擇微控制器（MCU），或是數(shù)字信號處理器（DSP）、現(xiàn)場可編程邏輯門陣列（FPGA），甚至是單片機(jī)（SBC）來負(fù)責(zé)系統(tǒng)的計(jì)算與控制工作，以下將為您進(jìn)行微處理器等相關(guān)產(chǎn)品的概要介紹。
2024-05-06
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BYO、FPGA開發(fā)板與商用，一文詳解各類原型驗(yàn)證
幾十年來，數(shù)字芯片設(shè)計(jì)復(fù)雜度不斷攀升，使芯片驗(yàn)證面臨資金與時間的巨大挑戰(zhàn)。在早期，開發(fā)者為了驗(yàn)證芯片設(shè)計(jì)是否符合預(yù)期目標(biāo)，不得不依賴于耗時的仿真結(jié)果或是等待實(shí)際芯片生產(chǎn)（流片）的成果。無論是進(jìn)行多次仿真模擬還是面臨流片失敗，都意味著巨大的時間和金錢成本。
2024-03-29
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為什么采用聚合物鋁電解電容器可以解決電源設(shè)計(jì)的痛點(diǎn)？
在設(shè)計(jì) USB 電源以及電子系統(tǒng)和子系統(tǒng)（包括 IC、特定應(yīng)用 IC (ASIC)、中央處理器 (CPU) 和現(xiàn)場可編程門陣列 (FPGA)）的功率輸送解決方案時，設(shè)計(jì)人員會不斷尋找方法來提高效率，同時確保以緊湊的外形尺寸在寬溫度范圍內(nèi)提供穩(wěn)定、無噪聲的功率。他們需要提高效率、穩(wěn)定性和可靠性，降低成本，并縮小解決方案的外形尺寸。同時，還必須滿足應(yīng)用中不斷增多的功率性能要求，包括平滑處理電源電路的輸入和輸出電流、支持峰值功率需求以及抑制電壓波動。
2024-03-15
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利用FPGA進(jìn)行基本運(yùn)算及特殊函數(shù)定點(diǎn)運(yùn)算
FPGA以擅長高速并行數(shù)據(jù)處理而聞名，從有線/無線通信到圖像處理中各種DSP算法，再到現(xiàn)今火爆的AI應(yīng)用，都離不開卷積、濾波、變換等基本的數(shù)學(xué)運(yùn)算。但由于FPGA的硬件結(jié)構(gòu)和開發(fā)特性使得其對很多算法不友好，之前本人零散地總結(jié)和轉(zhuǎn)載了些基本的數(shù)學(xué)運(yùn)算在FPGA中的實(shí)現(xiàn)方式，今天做一個系統(tǒng)的總結(jié)歸納。
2024-02-21
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如何用內(nèi)部邏輯分析儀調(diào)試FPGA？
進(jìn)行硬件設(shè)計(jì)的功能調(diào)試時，FPGA的再編程能力是關(guān)鍵的優(yōu)點(diǎn)。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設(shè)計(jì)不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當(dāng)設(shè)計(jì)的復(fù)雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設(shè)計(jì)很復(fù)雜時，通常完成設(shè)計(jì)后只有幾個空余的引腳，或者根本就沒有空余的引腳能用于調(diào)試。
2024-02-04
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實(shí)現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換：深入了解Achronix JESD204C解決方案
長期以來，Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應(yīng)用提供了創(chuàng)新性的FPGA產(chǎn)品和技術(shù)，并幫助客戶不斷打破性能極限。其中一些應(yīng)用需要與先進(jìn)的模擬/數(shù)字轉(zhuǎn)換器（ADC）和數(shù)字/模擬轉(zhuǎn)換器（DAC）進(jìn)行對接——可由JESD204C完美地完成這項(xiàng)任務(wù)。
2023-12-27
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基于STEP FPGA的旋轉(zhuǎn)編碼器電路驅(qū)動
旋轉(zhuǎn)編碼器是用來測量轉(zhuǎn)速的裝置，因其人性化的操作被用于越來越多的電子設(shè)備中，旋轉(zhuǎn)編碼器有多種分類：以編碼器工作原理可分為：光電式、磁電式和觸點(diǎn)電刷式。以碼盤刻孔方式不同分為：增量式和絕對式兩類。
2023-11-29
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一種基于電流源基準(zhǔn)型LDO的放大器供電時序電路的應(yīng)用
相信你們在設(shè)計(jì)電路中經(jīng)常會碰到有時序要求的電路，比如說FPGA數(shù)字電路的供電，比如我們給模擬放大器的供電，等等。通常來說，我們有sequencers這種產(chǎn)品，其中又分為模擬時序控制芯片和數(shù)字時序控制芯片；模擬時序控制芯片，將電源輸出電壓作為輸入信號，實(shí)時監(jiān)測電源輸出，當(dāng)電源輸出達(dá)到閾值時，會給一個類似于power good的電平信號，這樣可以將這個電平信號控制下一級電源的EN，從而控制下一級電源電路的開啟，從而達(dá)到時序控制的目的。
2023-11-10
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用FPGA構(gòu)建邊緣AI推理應(yīng)用很難？這樣做，變簡單！
對于希望在邊緣的推理處理器上實(shí)施人工智能 (AI) 算法的設(shè)計(jì)人員來說，他們正不斷面臨著降低功耗并縮短開發(fā)時間的壓力，即使在處理需求不斷增加的情況下也是如此?，F(xiàn)場可編程門陣列 (FPGA) 為實(shí)施邊緣AI所需的神經(jīng)網(wǎng)絡(luò) (NN) 推理引擎提供了特別有效的速度和效率效率組合。然而，對于不熟悉 FPGA 的開發(fā)人員來說，傳統(tǒng)FPGA的開發(fā)方法可能相當(dāng)復(fù)雜，往往導(dǎo)致他們?nèi)ミx擇不太理想的解決方案。
2023-11-02
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如何實(shí)現(xiàn)高效的供電網(wǎng)絡(luò) (PDN) 設(shè)計(jì)
在為 5G 應(yīng)用設(shè)計(jì)電源系統(tǒng)時，設(shè)計(jì)人員必須考慮此類應(yīng)用固有的寬頻率范圍，從穩(wěn)壓器中的中頻到 FPGA內(nèi)核中的高時鐘頻率。這種端到端的全雙工設(shè)計(jì)對于優(yōu)化電源、電源轉(zhuǎn)換和配電過程的性能至關(guān)重要。
2023-10-30
- 從ECU到BMS：厚膜電阻在汽車電子系統(tǒng)中的全應(yīng)用場景
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